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verify rule check

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2018-07-31 08:37  |  Posted By 신명균

본문

verify 디자인룰 체크를 할때 clearance 확인을 하는데 그 부분에서 에러가 발생하는 부분은 사용자가 모두 해결을 하고 넘어가야 되는문제인가요 ? 아니면 무시하고 그냥 넘어가도 되는 문제인가요 ??
Comments

ED&C님의 댓글

ED&C  |

안녕하십니까? ED&C입니다
PCB 디자인에서 Clearance 확인은 꼭 필요한 DRC 체크입니다.
Error가 있으면 모두 해결하셔야 합니다.
감사합니다.


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