Clearance Error
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2025-08-11 13:39 | Posted By 안종수
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배선 작업 후 Clearance Error를 체크하던 중
Hatch outline, VIA overlapping Error가 발생하였습니다.
기존 회로도에서는 발생하지 않았는데 회로를 수정하면서 발생한 것으로 보입니다.
디자인 룰 변경으로 해결이 가능한 것인지 아니면 반드시 배선 수정을 통해서 에러를 해결해야하는 것인지
궁금하여 문의드립니다,
ED&C님의 댓글
ED&C |안녕하십니까? ED&C입니다.
디자인 룰 변경이 없다는 가정하에
수정하면서 Error 체크에서 내용 있다면 당연히 PCB 설계에서 수정을 하는 것이 맞을 것 같습니다.
감사합니다.